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PCI (Master/Target, 32bit) IP

PCI レガシーインタフェース対応

概  要

PCI IPは、マスター/ターゲットまたはターゲットデバイス機能をサポートしています。ユニバーサルなユーザーインタフェース構成になっているため、PCIのプロトコルを意識せずにユーザー回路と接続可能です。
また、PCIインタフェースデバイスがディスコンなどで入手できなくなった場合に、本IPをFPGAに実装することで置き換えが可能です。

お問い合わせ

特  長

  • PCI Local Bus Specification Revision 2.3に準拠
  • マスター/ターゲット または ターゲット デバイス機能をサポート
  • バースト転送/プリフェッチ転送をサポート
  • 32bit対応、33MHz対応
  • 割り込み、システムエラー、パリティエラー対応

仕  様

対応コマンド 備考
メモリサイクル メモリ・リード -
メモリ・リード・ライン -
メモリ・リード・マルチプル -
メモリ・ライト -
I/Oサイクル I/O・リード -
I/O・ライト -
コンフィグレーションサイクル コンフィグレーション・リード ターゲット動作のみ対応します
コンフィグレーション・ライト
スペシャルサイクル -
デュアルアドレスサイクル - メモリサイクルのみ対応します

対応デバイス

  • Cyclone III/IV/V
    (※その他のデバイスの対応状況については、弊社営業までお問い合わせください)

提供物

  • RTL(Verilog HDL)
  • シミュレーション環境(ModelSim用)
  • ユーザーズマニュアル

ロジックリソース

  • Cyclone III
    • Total logic elements :2,133 LE
    • Total registers :1,181
    • Total memory bits :0

システム構成例

  • PCI IPによって、PCIカードとコントローラボード間のコマンド送受信を制御
  • コントローラボードからのコマンドに対し、メモリまたは外部I/Oとして動作